芯片設(shè)計崗位職責(zé)（精選7篇）
芯片設(shè)計崗位職責(zé) 篇1
職位描述
1. ARM SOC架構(gòu)設(shè)計
2. ARM SOC頂層集成
2. ARM SOC的模塊設(shè)計
任職要求Must have:
1.精通Verilog語言
2.了解UVM方法學(xué);
3. 2-4年芯片設(shè)計經(jīng)驗;
4. 1個以上的SOC項目設(shè)計經(jīng)驗
5.精通AMBA協(xié)議
6.良好的溝通能力和團(tuán)隊合作能力
Preferred to have:
1. ARM子系統(tǒng)設(shè)計經(jīng)驗
2. AMBA總線互聯(lián)設(shè)計
3. DDR3/4, SD/SDIO設(shè)計經(jīng)驗
4. UART/SPI/IIC設(shè)計調(diào)試經(jīng)驗
5.芯片集成經(jīng)驗
芯片設(shè)計崗位職責(zé) 篇2
1.精通verilog語言
2.熟悉nlint/spyglass/vcs等相關(guān)工具
3.了解uvm方法學(xué)
4. 2~3年芯片設(shè)計經(jīng)驗
5. 1個以上asic項目設(shè)計經(jīng)驗
6.精通amba協(xié)議
7.良好的溝通能力和團(tuán)隊合作能力
芯片設(shè)計崗位職責(zé) 篇3
負(fù)責(zé)芯片設(shè)計項目中數(shù)字前端設(shè)計開發(fā)工作,包括文檔編寫,RTL編碼、形式驗證、綜合時序驗證等工作,實現(xiàn)芯片功能、性能要求等;
任職要求:
1.電子工程,微電子相關(guān)專業(yè)本科及以上學(xué)歷;3年以上前端設(shè)計開發(fā)工作經(jīng)驗;
2.熟悉ASIC設(shè)計流程,熟練使用Verilog,熟練使用各種EDA工具,熟悉邏輯綜合工具等;
3.有豐富的'頂層設(shè)計和前端IP集成經(jīng)驗優(yōu)先;有算法開發(fā)經(jīng)驗,可高效的實現(xiàn)算法到AISC映射者優(yōu)先;
4.熟悉PCIeAXI等協(xié)議,內(nèi)部總線互聯(lián)設(shè)計及深度學(xué)習(xí)背景者優(yōu)先;
5.具有良好的溝通能力和團(tuán)隊合作精神。有豐富的頂層設(shè)計和前端IP集成經(jīng)驗優(yōu)先;有算法開發(fā)經(jīng)驗,可高效的實現(xiàn)算法到AISC映射者優(yōu)先;職責(zé)描述:
負(fù)責(zé)芯片設(shè)計項目中數(shù)字前端設(shè)計開發(fā)工作,包括文檔編寫,RTL編碼、形式驗證、綜合時序驗證等工作,實現(xiàn)芯片功能、性能要求等;
任職要求:
1.電子工程,微電子相關(guān)專業(yè)本科及以上學(xué)歷;3年以上前端設(shè)計開發(fā)工作經(jīng)驗;
2.熟悉ASIC設(shè)計流程,熟練使用Verilog,熟練使用各種EDA工具,熟悉邏輯綜合工具等;
3.有豐富的頂層設(shè)計和前端IP集成經(jīng)驗優(yōu)先;有算法開發(fā)經(jīng)驗,可高效的實現(xiàn)算法到AISC映射者優(yōu)先;
4.熟悉PCIeAXI等協(xié)議,內(nèi)部總線互聯(lián)設(shè)計及深度學(xué)習(xí)背景者優(yōu)先;
5.具有良好的溝通能力和團(tuán)隊合作精神。
芯片設(shè)計崗位職責(zé) 篇4
職責(zé)描述:
參與芯片的架構(gòu)設(shè)計，和算法的硬件實現(xiàn)和優(yōu)化.
完成或指導(dǎo)工程師完成模塊級架構(gòu)和RTL設(shè)計
根據(jù)時序、面積、性能、功耗要求，優(yōu)化RTL設(shè)計
參與芯片開發(fā)全流程，解決芯片設(shè)計過程中的技術(shù)問題，確保設(shè)計、驗證、時序達(dá)成
支持軟件、驅(qū)動開發(fā)和硅片調(diào)試
任職要求:
電子工程、微電子或相關(guān)專業(yè)，本科或碩士6年以上工作經(jīng)驗
較強的verilogHDL能力和良好的代碼風(fēng)格，能夠根據(jù)需求優(yōu)化設(shè)計
熟悉復(fù)雜的數(shù)據(jù)通路與控制通路的邏輯設(shè)計，有扎實的時序、面積、功耗、性能分析能力，較強的調(diào)試、ECO和硅片調(diào)試能力
熟悉前端設(shè)計各個流程，包括構(gòu)架、設(shè)計、和驗證，熟悉常用EDA仿真和實現(xiàn)工具
較強的script能力，比如Perl，Python，Ruby，或相關(guān)語言
具備以下任一經(jīng)驗者尤佳:熟悉計算機(jī)體系結(jié)構(gòu)相關(guān)知識、熟悉CPU或GPU軟硬件系統(tǒng)架構(gòu)、熟悉低功耗設(shè)計
較強的解決問題能力，良好的溝通能力和團(tuán)隊協(xié)作和領(lǐng)導(dǎo)能力
良好的英文文檔閱讀與撰寫能力
芯片設(shè)計崗位職責(zé) 篇5
1.邏輯綜合，形式驗證及靜態(tài)時序分析；
2.規(guī)劃芯片總體dft方案；
3.實現(xiàn)scan，boardary scan，bist和analog micro測試等機(jī)制，滿足測試覆蓋率要求；
4.測試向量生成及驗證，參與ate上測試向量的調(diào)試；
5.編寫文檔，實現(xiàn)資源、經(jīng)驗共享。
芯片設(shè)計崗位職責(zé) 篇6
1、根據(jù)系統(tǒng)工程師的要求，設(shè)計相應(yīng)的低速數(shù)字電路通信的接口模塊(i2c，spi，uart等)。
2、根據(jù)系統(tǒng)工程師的要求，設(shè)計相應(yīng)的寄存器控制模塊，校驗算法，狀態(tài)機(jī)。
3、熟悉后端流程，可將驗證完的rtl生成相關(guān)數(shù)字電路的gds。
4、完成相關(guān)數(shù)字電路模塊在fpga上的驗證，搭建mcu，fpga的驗證平臺，參與芯片的數(shù)字部分測試。
芯片設(shè)計崗位職責(zé) 篇7
1、本科及以上學(xué)歷，電子相關(guān)專業(yè)，熟悉IC設(shè)計與驗證技術(shù)；
2、熟悉verilog和面向?qū)ο缶幊蹋行酒O(shè)計驗證項目經(jīng)驗者優(yōu)先；
3、掌握system verilog或熟悉UVM、VMM者優(yōu)先。